Files
vhdl/lib/CPUs/MIPS/todo.txt
T
jens d3b5902e23 update
Committed on the Free edition of March Hare Software CVSNT Server.
Upgrade to CVS Suite for more features and support:
http://march-hare.com/cvsnt/


git-svn-id: http://moon:8086/svn/vhdl/trunk@694 cc03376c-175c-47c8-b038-4cd826a8556b
2010-01-09 17:53:09 +00:00

36 lines
1.5 KiB
Plaintext

2008-10-26
- Area-Optimierung: DIV und MUL verwenden gleiche Ressourcen
- Area-Optimierung: MUL32x32 primitive für Virtex-4
- shifter: log shifter besser als built-in sll, srl, sra? Nein (2008-10-27)
- External COP 1..3 interface
- FPU (COP1)
- MMU
2008-10-27
- Area vs. speed : Pipeline-stall statt forwarding
- Caches: - Lock-up free cache (refill critical word first then un-lock CPU) (geringer Effekt, zu kompliziert => geringere Zuverlässigkeit)
- 1,2,4-way assoziative
- 2nd-Level cache in System
- Write-back policy
2008-11-15
- Bus exceptions IBE DBE (BUI/Cache restart notwendig)
2009-03-18
- cache line sizes von 1 word (4 bytes) gibt NULL-vector. Fehler in Berechnung der inedx_widths
2009-8-8
- Soft-Reset. Ähnlich wie Exception (Reset/NMI). Speicherung von EPC (done)
- CP_COND
2009-10-17
- Soft-reset implemetiert. Register werden wie bei normaler Exception verändert.
TodO: Bei Soft-reset (laut Buch) KUc=0, IEc=0 und BEV=1 initialisieren
- Uncached write: Geht wie bei cached-write in den Write-Buffer. Folge: Mögliche lange Latenz bis uncached memory-mapped I/O tatsächlich geschieben wird.
Könnte bei IRQ acknowledging Probleme bereiten (z.b. mehrfaches (unötiges) anspringen der ISR, obwohl IRQ schon acknowleded wurde).
Work-around: Nach schreiben von memory-mapped I/O, gleiche Adresse zurücklesen (lesen wartet bis write-buffer leer).
2010-01-09
- COP dependency einführen => Pipeline stall, wenn COP Daten nicht verfügbar